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请问出现只有高电平为高阻态的情况是由什么造成的?

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发表于 2016-11-21 16:06:22 | 显示全部楼层 |阅读模式
wire [23:0] rd_data_720p_0;

xxx xxxxx
(
...,
...,
.OUT(rd_data_720p_0),
...,
)

module xxx
(
...
...
OUT,
...
)
...
output wire [23:0] OUT;
...
endmodule

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发表于 2016-11-22 12:26:10 | 显示全部楼层
将该信号独立出来,给它单独赋值看下仿真结果为高电平的时候是不是高阻态。
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